
Von der Konnektivität zur Zuverlässigkeit: Skalierung der formalen Verifikation in komplexen digitalen Steuerungen
Simulationen zeigen, was möglich ist. Formale Verfahren beweisen, was garantiert ist. Ein Überblick über den Hardware-Entwurf
Prasanna Venkatesan Kesavan ist stellvertretender Direktor und Leiter des Designzentrums in Chennai bei eInfochips (einem Unternehmen der Arrow-Gruppe), wo er den ASIC-Betrieb sowie durchgängige Silizium-Entwicklungsprogramme leitet, die von RTL bis GDSII, die Validierung nach der Siliziumfertigung, Firmware, eingebettete Software und Systemengineering umfassen. Mit mehr als 20 Jahren Erfahrung in der Halbleiterindustrie war er in den Bereichen Luft- und Raumfahrt, Automobilindustrie, Netzwerktechnik und KI tätig und hat komplexe SoC-, IP-Verifikations- und Designinitiativen auf Systemebene vorangetrieben.
Prasanna ist spezialisiert auf SoC- und IP-Verifikation, SystemC-basierte Modellierung, die Entwicklung virtueller Plattformen, funktionale Sicherheit, Halbleiterarchitekturen für die Automobilindustrie sowie das Management groß angelegter Entwicklungsprogramme. Im Laufe seiner Karriere hatte er technische und leitende Positionen bei eInfochips, HCL Technologies, Intel, Broadcom, Infineon Technologies und der Aeronautical Development Agency inne und trug dort zur Entwicklung und Verifikation fortschrittlicher Halbleiter- und Embedded-Systeme bei.
Prasanna engagiert sich aktiv in der Halbleiterbranche und hatte bei der DVCon India bereits mehrere Führungspositionen inne, darunter die des Vorsitzenden, des stellvertretenden Vorsitzenden und des Mitglieds des Fachprogrammausschusses. Er hat einen Bachelor of Engineering der University of Madras und einen PGCBM in Betriebswirtschaftslehre der XLRI Jamshedpur.

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