Hochgeschwindigkeits-DDR- und LPDDR-Schnittstellen unterliegen immer strengeren Timing- und Spannungsbeschränkungen. Prozessschwankungen, Spannungsschwankungen, Temperatur, Jitter, Rauschen und Kanaleffekte können die Zuverlässigkeit des Speichers beeinträchtigen und die Validierungsabläufe für PHYs erheblich verkomplizieren.
Die DDR-PHY-VREF-Charakterisierungslösung bewältigt diese Herausforderungen durch die Automatisierung der Empfängercharakterisierung mittels kontrollierter VREF- und Abtastverzögerungs-Sweeps. Sie ermöglicht es Entwicklungsteams, DDR-Lese-Augen-Diagramme zu erstellen, verfügbare Margen zu quantifizieren, leistungsschwache Bits zu identifizieren und den optimalen PHY-Betriebspunkt zu ermitteln. Die Lösung wurde speziell für moderne DDR- und LPDDR-Schnittstellen entwickelt und liefert verwertbare Margeninformationen über Kanäle, Ranks, Byte-Lanes und einzelne DQ-Bits hinweg. So können Teams die Zuverlässigkeit verbessern, die Debugging-Zeit verkürzen und die Leseleistung optimieren.
Die Lösung unterstützt die Entwicklung von DDR-PHYs, die Inbetriebnahme von Chips, die PVT-Charakterisierung, die Produktqualifizierung, das Fertigungsscreening und die Fehleranalyse.
1. Silicon-Bring-Up: Identifiziert Probleme hinsichtlich Timing, Spannung und Empfangsreserve während der Validierung des ersten Siliziumchips.
2. Entwicklung der DDR-PHY-Schicht: Unterstützt die Empfängerabstimmung, die Bewertung des Lesetrainings und die Optimierung der PHY-Leistung.
3. PVT-Charakterisierung: Bewertung des Leseverhaltens von DDR-Speichern unter verschiedenen Prozess-, Spannungs- und Temperaturbedingungen.
4. Produktqualifizierung: Liefert reproduzierbare Charakterisierungsdaten für die Validierung auf Design- und Systemebene.
5. Fertigung und Prüfung: Bewertung der Produktionsmargen und Ermittlung von Geräten oder Konfigurationen, die nahe an festgelegten Grenzwerten arbeiten.
6. Fehleranalyse: Untersucht schwache Bits, Jitter-Empfindlichkeit, Probleme hinsichtlich der Signalintegrität und eine Verschlechterung der Sicherheitsmargen.
Je nach Auftrag und Zielplattform können die Leistungen Folgendes umfassen:
Ausführliche Informationen zu den unterstützten Ausgängen, Messgrößen, Testmusteroptionen und Charakterisierungsparametern finden Sie im Datenblatt der Lösung.
Bei der DDR-PHY-VREF-Charakterisierung wird die Empfängerleistung gemessen, indem die Einstellungen für die Spannungsreferenz und die Abtastverzögerung über das gesamte DDR-Lesefenster hinweg variiert werden. Dies hilft bei der Bestimmung der Augenbreite, der Augenhöhe, der Timing-Marge, der Spannungsmarge und des optimalen Arbeitspunkts des Empfängers.
Eine DDR-Schnittstelle kann grundlegende Funktionstests bestehen, obwohl sie noch mit begrenzten Zeit- oder Spannungsreserven arbeitet. Die „Read-Eye“-Charakterisierung zeigt, wie viel Betriebsreserve verfügbar ist, und hilft dabei, schwache oder grenzwertige Zustände noch vor Produktionsbeginn zu erkennen.
Die Lösung unterstützt DDR4, DDR5, LPDDR4, LPDDR4X, LPDDR5, LPDDR5X sowie kundenspezifische DDR-PHY-Implementierungen.
Die Lösung misst Parameter wie Augenbreite, Augenhöhe, Augenmittelpunkt, Timing-Marge, Spannungsmarge, beste VREF, beste Verzögerung, Augenfläche, BER-Verhalten und Bit-Marge.
Ja. Die Charakterisierung kann auf PHY-, Kanal-, Rang-, Byte-Lane-, DQS-Gruppen- und individueller DQ-Bit-Ebene durchgeführt werden, was Ingenieuren dabei hilft, schwache oder grenzwertige Bereiche zu isolieren.
Ja. Es kann zur Bewertung des Verhaltens der DDR-PHY unter verschiedenen Prozess-, Spannungs- und Temperaturbedingungen verwendet werden.
Ja. Die Lösung hilft dabei, Probleme hinsichtlich Timing, Spannung, Kalibrierung und Sicherheitsmargen während der Validierung des ersten Siliziumchips zu erkennen.
Ja. Die Lösung kann konsolidierte technische Ausgabedaten erstellen und diese in Formaten wie CSV, Excel, PDF und HTML exportieren.
Ja. Das Charakterisierungs-Framework lässt sich an kundenspezifische PHY-Architekturen, Registerschnittstellen, Testabläufe und Berichtsanforderungen anpassen.
Es automatisiert wichtige Schritte wie die PHY-Konfiguration, VREF- und Verzögerungs-Sweeps, die Ausführung von Lesevorgängen, die Datenerfassung, die Fehleranalyse, die Erzeugung von Eye-Diagrammen, die Extraktion von Metriken und die Berichterstellung.
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