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X-Propagationssimulation: Eine leistungsstarke Funktion
Ein Überblick Im VLSI-Design ist die „Verifikation“ ein entscheidender Schritt zur Überprüfung der Korrektheit und
Abhay Sonagara
15. Juni 2026
Abhay Sonagara ist Senior Engineer für ASIC-Verifikation – Stufe 1 bei eInfochips, einem Unternehmen der Arrow-Gruppe. Er ist auf die funktionale Verifikation von ASIC-, IP-, FPGA- und SoC-Designs spezialisiert und sorgt durch effiziente Testbench-Entwicklungstechniken, einen lückenlosen Verifikationsplan und die Erstellung umfassender Testszenarien für DV-Simulationen für die Auslieferung fehlerfreier RTL-Designs. Er verfügt über mehr als 4,5 Jahre Erfahrung in der funktionalen Designverifikation verschiedener RTL-Designs.
Er hat die Testumgebungen von Grund auf entwickelt und auch angepasst, darunter UVM-Komponenten wie UVC, Monitor, Driver, Referenzmodell, Scoreboard und Agenten. Außerdem verfügt er über praktische Erfahrung mit Metriken zur Code- und Funktionsabdeckung, Assertions, VIP-Integration, X-Prop und Simulationen auf Gate-Ebene.
Ein Überblick Im VLSI-Design ist die „Verifikation“ ein entscheidender Schritt zur Überprüfung der Korrektheit und
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