派生製品は、市場や技術の進化に応じて、いくつかのカテゴリーに分けることができる。ASICやSoCの複雑さを考慮すると、半導体企業が設計するチップのほとんどは、前世代のチップの派生品である。これはエンジニアリングチームに出発点を与えるものの、IPを統合する際に複雑さを増し、配線やタイミングの問題が増加する可能性がある。
eInfochipsは、大手半導体企業向けに複数世代のASICを手掛けてきた経験を活かし、モジュール性と再利用性に重点を置き、これらの派生ASICの検証サイクルタイムを短縮するためのガイドライン、フレームワーク、再利用可能な検証コンポーネントを開発しました。同時に、フィジカル設計チームは自社開発のFlow Management SystemとDFT自動化ツールを活用し、より迅速なテープアウトを実現しています。
IPの開発と統合における豊富な経験
シミュレーションのレビューとデバッグの高速化のためのスクリプトとツール。
10以上の再利用可能な検証コンポーネントとフレームワーク
歩留まり向上とフィードバックのための主題専門家
Comprehensive checklist for database handoff: Netlist to GDSII in < 3 iterations
カスタマイズされたフロー開発と自動化の専門知識
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