Conception de puces clé en main

eInfochips propose des services clés en main de conception d'ASIC et de SoC de bout en bout, en gérant l'ensemble du cycle de vie des puces, depuis l'architecture et le développement RTL jusqu'au format GDSII et à la préparation de la production. Nous aidons les principaux innovateurs du secteur des semi-conducteurs à accélérer la mise sur le marché grâce à une exécution prévisible et de haute qualité.

Avec plus de 400 tape-outs réussis sur des nœuds de fabrication avancés et matures allant de 3 nm à 180 nm, nous disposons d'une expertise approfondie sur diverses plateformes technologiques.

Nos équipes d'ingénieurs sont spécialisées dans la mise en œuvre complète du RTL au GDSII, y compris la vérification basée sur l'UVM, l'intégration DFT et AMS, l'émulation haute fidélité et la conception physique prête pour la validation finale. Nous accompagnons le développement de systèmes critiques pour la sécurité en garantissant la conformité aux normes internationales telles que l'ISO 26262 et la DO-254.

Nous travaillons en parfaite synergie avec les principaux écosystèmes de fonderies et d'EDA, notamment TSMC, Synopsys et Cadence, afin de garantir la livraison de puces fiables et prêtes pour la validation finale.

Notre modèle d'exécution entièrement intégré aide nos clients à réduire leurs coûts de développement (NRE), à améliorer les rendements et à accélérer le déploiement de dispositifs d'IA, automobiles, industriels et de périphérie, grâce à des méthodologies éprouvées et à une expertise de pointe en ingénierie des semi-conducteurs.

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Services clés en main de conception de puces d'eInfochips

Architecture et conception front-end

  • Définition des spécifications, conception de la microarchitecture et développement RTL
  • Sélection, intégration et planification de la réutilisation des adresses IP
  • Architecture optimisée en termes de consommation d'énergie et de gestion des domaines d'horloge (UPF/CPF)
  • Synthèse RTL, analyse Lint, analyse CDC/RDC et optimisation temporelle
  • Expérience dans le domaine des processeurs de signaux numériques, des contrôleurs et des accélérateurs d'IA

Vérification de la conception (DV)

  • Création et réutilisation d'environnements basés sur SystemVerilog UVM
  • Tests aléatoires, orientés et axés sur la couverture sous contraintes
  • Vérification formelle et par assertions pour les circuits intégrés à système sur puce (SoC) complexes
  • Couverture fonctionnelle et automatisation des tests de régression (Jenkins/Bamboo)
  • IP de vérification pour les interfaces PCIe, Ethernet, DDR, USB et personnalisées

Conception physique (PD) et conception pour le test (DFT)

  • Aménagement de l'espace, placement et acheminement, CTS, STA, analyse de l'alimentation électrique et des interférences IR/EM
  • Optimisation multi-coins et multi-modes (MCMM) et flux de validation
  • Planification DFT, insertion de balayage, ATPG, MBIST et balayage des limites
  • Conception à haute densité, faible consommation et haute performance pour les nœuds avancés (5 nm/3 nm)
  • Automatisation de la validation à l'aide de Synopsys IC-Compiler II, PrimeTime et Cadence Innovus

Conception analogique et à signaux mixtes (AMS)

  • Conception sur mesure de circuits intégrés analogiques : PLL, ADC/DAC, LDO, CDR, AFE, interfaces de capteurs
  • Modélisation comportementale et SPICE, co-conception schéma-implantation dans Virtuoso
  • Simulation, vérification et intégration de haut niveau AMS
  • Migration entre les nœuds technologiques (130 nm → 28 nm → 7 nm)
  • Expertise en gestion de l'alimentation, en circuits d'acquisition de données pour capteurs et en SerDes

Émulation et validation post-silicium

  • Prototypage sur FPGA, modélisation sur plateforme virtuelle (SystemC/TLM) et mise en service de circuits intégrés (SoC)
  • Validation du système d'exploitation et du micrologiciel sur les plateformes Palladium, Zebu et HAPS
  • Tests au niveau de la carte, vérification à la mise sous tension et caractérisation PVT
  • Cadres d'automatisation pour les tests de fiabilité, de résistance et de régression
  • Développement de programmes ATE, validation des interfaces et analyse du rendement

Conditionnement, fabrication et assistance tout au long du cycle de vie

  • Conception conjointe d'emballages
  • Collaboration avec les prestataires de services d'assemblage sur site (OSAT) pour l'assemblage, la fiabilité et la qualification
  • Intégration d'Arrow et de SiliconExpert pour l'analyse des risques liés aux nomenclatures et la continuité
  • Accompagnement à la montée en puissance de la production, refonte de produits en fin de vie et ingénierie de maintenance

Infrastructure clé en main de bout en bout, du silicium au système

Chez eInfochips, nous proposons des programmes clés en main de bout en bout pour les ASIC et les SoC grâce à une infrastructure sécurisée, des environnements d'ingénierie standardisés, des laboratoires de validation de pointe et une gestion intégrée de la chaîne d'approvisionnement. Notre infrastructure est conçue pour garantir des sorties de circuit prévisibles, la protection de la propriété intellectuelle, une exécution accélérée et la continuité de la production à long terme.

Configurations ODC dédiées pour les programmes clés en main

  • Espaces d'ingénierie certifiés ISO 27001 et à accès contrôlé
  • VPN sécurisé, ressources informatiques isolées, pools de licences par projet
  • Équipes hybrides sur site et à distance pour les programmes ASIC exigeants

Laboratoire et validation
Infrastructure

  • Laboratoires de prototypage FPGA (HAPS, Zebu, émulateurs fournis par le client)
  • Postes de mise en service de circuits intégrés équipés d'oscilloscopes, d'analyseurs logiques et d'analyseurs de puissance
  • Chambres climatiques pour les essais de résistance aux contraintes thermiques et électriques
  • Bancs d'essai automatisés pour la validation des micrologiciels et des interfaces
  • Validation des appareils dans les secteurs des réseaux, de l'automobile, des produits grand public et de l'Internet des objets

Pile d'ingénierie silicium standardisée et automatisée

  • Flux RTL-GDSII intégrés dans les écosystèmes EDA de référence
  • Tests de régression pilotés par CI/CD, frameworks UVM/DFT/AMS réutilisables
  • Listes de contrôle indispensables pour la validation finale des phases RTL, PD, STA, DFT et LVS/DRC
  • Accélérateurs internes : PerfMon, AMSify, Scoreboardnetic, DFT-Cert

Intégration d'Arrow et de SiliconExpert dans l'

  • Prévision des risques liés à la nomenclature et estimation de la fin de vie (EOL)
  • Planification de la continuité de la chaîne d'approvisionnement et visibilité sur le cycle de vie
  • Coordination de l'emballage et des tests finaux par l'intermédiaire de plus de 10 partenaires OSAT spécialisés
  • Un écosystème solide donnant accès à plus de 60 fournisseurs VIP et plus de 50 fournisseurs de propriété intellectuelle pour une intégration accélérée
  • Partenariats avec des fabricants sous contrat et des prestataires de services de fabrication électronique (EMS) pour la conception de systèmes complets et la production en grande série
  • Approvisionnement en matériel et soutien à la viabilité à long terme

Accélérateurs et IP

Moniteur d'analyse des performances
(PerfMon / PAM)

IP de vérification (VIP)

IP de vérification Ethernet

Scoreboardnetic
(Tableau de bord de vérification)

AMSify

Générateur d'
s sur le modèle mémoire

OptiX – Cadre d'
s pour la conception physique

Cadre d'
s de conception physique

Outil d'exécution automatisée et de reporting de l'
ation DFT (DAeRT)

Utilitaire DFT

ConForum pour le cadre DFT

Écosystème de partenariats

Nos partenariats avec des leaders du secteur permettent des innovations de pointe dans le domaine des semi-conducteurs, garantissant une mise en œuvre clé en main fiable et des cycles de développement de puces accélérés.

Fonderie

Logo Texas Instruments

EDA et outils

Appareils et plateformes

Logo NVIDIA
NXP
Logo Microchip
Logo STMicroelectronics
Logo_Analog_Devices

Perspectives

Solution clé en main de conversion RTL vers GDSII + mise en service du silicium pour un SoC de capteur de mouvement

Circuit intégré ASIC pour contrôleur de zone automobile

Exécution clé en main de la conversion RTL vers GDSII pour les circuits intégrés ASIC destinés aux réseaux haute performance

Pourquoi choisir eInfochips pour la conception de puces clés en main ?

Responsabilité de bout en bout

Architecture, RTL, vérification, PD, DFT, AMS, validation et conditionnement.

Refonte et migration des systèmes existants

Regrouper plusieurs dispositifs en dérivés à puce unique optimisés en termes de coûts.

Exécution conforme aux exigences réglementaires

Processus de conception conformes aux normes ISO 26262, DO-254, AS9100D et CEI 61508.

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Silicium « First-Time-Right »

Des cadres éprouvés et des processus automatisés garantissant une clôture plus rapide et une réduction des retouches.

Continuité de la chaîne d'approvisionnement

L'écosystème d'Arrow Electronics pour la gestion des risques liés aux nomenclatures et l'accompagnement tout au long du cycle de vie.

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